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基于双C6678 DSP 阵列的图像目标识别跟踪器

(型号:EF-DSP-6678D-A01)

基于双C6678 DSP 阵列的图像信息处理单元

基于双C6678 DSP 阵列的图像信息处理单元核心由两片TMS320C6678 DSP 处理器与一片CycloneIII FPGA 组成,内部结构框图如图2 所示。每颗DSP 均配备四片16 位128MB 共512MB DDR3 存储器,以保证每一片DSP能够达到64 位1600MHz 外部数据访问性能。一片256MB 的NAND FLASH 用于预存图像数据,一片32MB NOR FLASH 通过EMIF 接口直接与系统内部总线相连,作为上电引导程序存储器,同时预留一片EEPROM 作为上电引导备用存储器。两颗DSP 之间使用HyperLink 总线和2 通道串行RapidIO 互连。HyperLink 总线最高提供50Gbps 传输速率传输速率,单路串行RapidIO 最高提供5Gbps 传输速率。这一设计保证了两颗DSP 之间进行数据交换的最大性能,提高了两片DSP协同工作的工作效率,为海量实时数据处理提供了强大的支撑。除高速串行接口外,两颗DSP 将GPIO、定时器、复位控制管脚、UART、SPI均连接至CycloneIII FPGA,作为命令传输及控制通道。

 

CycloneIII FPGA 作为图像信息处理单元的逻辑控制核心,与两颗DSP、电源电路、时钟产生单元相连,完成系统上电逻辑控制、各数据缓冲器使能、时钟芯片烧写配置、DSP 低速通信接口电平转换等工作,保证系统稳定有序地运行。FPGA外部配备EPCS16 配置FLASH,50MHz 有源晶振为板内上电时序逻辑提供参考时钟。

整板对外提供高速串行接口包括:四路SRIO 接口、四路PCIe 接口、四路SGMII接口,充足的高速接口为多DSP 图像信息处理阵列的设计任务预留了足够的扩展空间。图像信息处理单元采用单一5V 直流供电,最大电流6A。

图像目标实时跟踪算法特点:

(1)6678DSP 端图像目标跟踪实时处理,包括SYS/BIOS,模拟视频采集、红外图像与可见光图像融合算法,图像目标跟踪算法,以太网通信等部分。

 图像融合算法,融合实时性小于40ms;

 图像目标识别跟踪算法,实时性均达到200ms 以内。

(2)PC 机基于OPENCV 平台的上层软件,包括软件参数控制界面,跟踪图像实时显示等部分,并提供6678DSP 端图像融合算法和图像目标识别跟踪算法的OPENCV 算法工程原型。

 

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